BM迭代算法

作品数：8被引量：14H指数：2
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一种BCH码编译码器的设计与实现被引量：9
《通信技术》2010年第12期24-25,186,共3页张彦 李署坚 崔金 
二元BCH码具有良好的代数结构和纠错能力,是应用最为广泛的码类之一。在此介绍了BCH(255,223)的编译码算法和硬件实现方法,针对二元BCH码提出了一种适合硬件模块化设计的BM迭代译码算法,并基于Xilinx公司的xc5vlx110t实现了BCH(255,223...
关键词：二元BCH码 FPGA编译码器 BM迭代算法 
面积优化RS编解码器的VLSI设计
《微电子学》2008年第6期878-881,共4页尧勇仕 顾晓峰 于宗光 
科技部科技型中小企业技术创新基金(07C26223201317);教育部新世纪优秀人才支持计划(NCET-06-0484);江苏省自然科学基金资助项目(BK2007026)
介绍了一种适用于数字电视广播视频(DVB)系统的面积优化RS(204,188)编解码器的VLSI设计。设计中,充分考虑DVB系统的特性,采用软硬件协调和优化的三级流水线结构,运用改进的Berlekamp-Massey迭代算法来实现,有效地缩小了RS编解码器的面积...
关键词：数字电视广播 面积优化 RS编解码器 BM迭代算法 
BM迭代算法的循环架构设计及实现被引量：1
《重庆邮电大学学报（自然科学版）》2008年第2期175-178,共4页陈黎明 邓林江 王琳 
国家自然科学基金项目(60272005);教育部新世纪优秀人才支持计划(NCE-04-0601)
BCH码的译码问题主要归结为一个关键方程的解决,即错误位置多项式的求解,BM迭代算法自1966年由Berlekamp-Massey提出以来经过不断改进,已经成为解决这一问题的成熟算法。提出了一种适合硬件实现的BM迭代算法的循环架构设计,并在此架构...
关键词：BM迭代算法 现场可编程逻辑阵列 循环架构设计 
光存储RS译码器设计与译码速度分析
《光电子．激光》2006年第7期779-782,共4页张金 熊剑平 马骋 
国家自然科学基金资助项目(60207001)
比较了reed-solomon(RS)译码的Berlekamp-Massey(BM)算法和Euclidean算法的运行速度,并选择BM算法设计了满足36 Mbps数据传输率(DTR)的RS译码器。针对现有几种光盘的DTR,进一步分析了光存储中RS译码速度的要求,并对译码中的有限域乘法...
关键词：RS码 BM迭代算法 Euclidean迭代算法 有限域乘法器 
变参数RS译码器IP核的实现被引量：1
《固体电子学研究与进展》2005年第3期357-360,415,共5页陈启亮 余宁梅 刘高辉 
日本OKI公司资助研究的国际合作项目
设计出一种码长可以变化的RS码译码器IP核电路,可进行RS(15,5)、RS(15,7)、RS(15,9)以及RS(15,11)的译码。译码器电路使用BM迭代译码算法,并在硬件电路中加以改进,使得电路能扩充到编译纠错位数多的复杂RS码。该译码器电路尽可能多地使...
关键词：RS译码器 IP核 BM迭代算法 
Reed-Solomon译码算法
《电子测量技术》2005年第6期11-12,共2页陈高华 林争辉 
文中利用BM迭代算法与最短线性反馈移位寄存器综合算法(LFSR)的相关性,提出基于VLSI设计的RS译码的实现方法。该方法实现译码器的标准单元化设计,并且有效提高译码的速度,简化硬件设计。
关键词：BM迭代算法 LFSR 综合算法 RS译码器 VLSI 译码算法 
一种RS码译码器的硬件实现方法被引量：1
《无线电通信技术》2004年第1期9-10,48,共3页王伟 徐辉 邹火儿 
提出了一种RS系统码译码器的硬件实现结构。译码器采用时域译码算法,主要包括有限域并行乘法器、BM迭代算法、适合于缩短码的钱氏搜索算法、错误值计算的硬件电路,其运算结构规则,具有一定的通用性,因此适合于VLSI实现。
关键词：RS码 译码器 时域译码 BM迭代算法 VLSI 
RS译码的BM迭代算法及其FPGA实现被引量：2
《电讯技术》2003年第5期100-102,共3页张辅云 葛建华 
数字视频广播关键技术研究基金资助
介绍了运用于RS译码中的BM迭带算法及利用BM迭带进行RS译码的基本原理,同时给出了该算法的FPGA实现,并通过在高清晰度数字电视接收机中验证了设计的可行性与可靠性。
关键词：RS译码 BM迭代算法 FPGA 高清晰度数字电视 接收机 
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