AVS解码器

作品数：18被引量：20H指数：3
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基于众核处理器的AVS并行解码器的设计与实现
《电视技术》2014年第15期84-87,共4页吴杰 张文军 高志勇 张小云 
国家自然科学基金项目(61301116);国家自然科学基金委创新群体项目(61221001)
众核处理器的并行计算为AVS并行解码器的实现提供了基础,提出了一种功能并行和数据并行混合的并行设计方案,该方案采用了帧间和宏块行的两级并行。使用Tilera推出的Tile-Gx36众核处理器,同时利用该处理器提供的SIMD指令集进行了反量化...
关键词：AVS解码器 Tile—Gx36 SIMD 并行解码 
在OMAP3530平台实现AVS解码器被引量：2
《电视技术》2014年第1期58-60,72,共4页展鹏飞 张杰飞 张刚 
详细讨论了OMAP架构的双核通信机制,分析了Codec Engine,DSPlink,CMEM等核心模块。然后实现了一种基于OMAP3530开发平台的AVS视频解码系统,实现了ARM处理器接收网络数据和显示图像,DSP处理器解码AVS码流。在Linux环境下将AVS视频解码器...
关键词：OMAP 双核通信 AVS 
AVS解码器环路滤波的优化及实现被引量：2
《电视技术》2013年第5期23-25,共3页魏晓君 张刚 
国家自然科学基金项目(60772101)
AVS编解码器采用环路滤波去除块效应来提高图像质量,而环路滤波复杂度高、运算量大,且滤波过程数据访问频繁,严重影响了代码的执行效率。为提高解码速率,通过分析滤波算法特点,调整滤波结构,优化滤波算法,部分代码采用DSP汇编语言。结...
关键词：AVS 环路滤波 汇编 
基于RVM的AVS视频解码芯片的验证
《科学技术与工程》2012年第23期5765-5770,共6页付芳芳 
随着集成电路设计规模和复杂度的不断增大,验证工作越来越重要。如何快速地搭建一个强大、高效的验证平台是工程师们关注的重点。基于业内常用的高级验证方法学RVM(Reference Verification Methodology),利用Vera验证语言搭建了一个层...
关键词：RVM验证方法学 AVS解码器 Vera语言 
基于XSBase270平台的AVS解码器亚像素插值优化被引量：1
《计算机应用与软件》2010年第7期219-222,267,共5页谢黎 张睿 
亚像素样本插值是视频解码器中计算量最大、耗时最长的部分,在我国第二代信源编码标准AVS的解码器中也不例外。通过图像扩展避免了获取整像素样本时的边界判断;根据运动矢量判断是否需要进行水平、垂直方向的色度分像素插值,据此对色度...
关键词：AVS 运动补偿 亚像素插值 优化 XSBase270 
AVS解码器复杂度分析被引量：3
《计算机应用与软件》2010年第5期67-70,共4页牛旭宁 张远 马思伟 徐龙 邓磊 
中国传媒大学亚洲传媒研究中心课题;国家自然科学青年基金(60803013)
为了满足视频解码器设计的需要,对AVS-P2视频解码器进行了复杂度分析[1]。首先根据AVS解码器的内存使用情况进行空间复杂度分析;其次通过计算解码器主要子功能模块的基本操作数从理论上估算解码器的时间复杂度;最后,对AVS解码器在一系...
关键词：AVS-P2 解码器 复杂度分析 
AVS解码器在DSP平台上的优化
《电子器件》2010年第1期132-134,共3页刘微 李向荣 
"973"项目资助(2009CB320905);山东省博士后科研项目专项经费资助(200602009)
为在嵌入式DSP平台上提高AVS解码器的运行效率,提出一种基于L1P cache的优化方法。将程序代码划分为4个模块,每个模块容量均小于L1P的容量;并改变传统的针对单个宏块进行顺序处理的模式,使每个程序模块依次处理一个宏块行的数据,从而减...
关键词：AVS CACHE 优化 解码器 
AVS解码器帧内预测模块硬件优化设计被引量：1
《小型微型计算机系统》2010年第1期183-185,共3页黄友文 陈咏恩 
根据AVS标准中的帧内预测算法特点提出一种用于AVS解码器的帧内预测硬件模块优化设计方案,该设计使用两维滤波单元对参考数据进行处理,每个块的帧内预测运算在8个时钟周期内完成.与此同时,结合寄存器的移位操作简化参考数据选择机制,避...
关键词：AVS标准 视频解码 帧内预测 硬件设计 
AVS解码器帧内预测并行自适应硬件实现被引量：2
《电视技术》2009年第S2期51-53,共3页刘畅 熊付荣 
分析了AVS标准帧内预测的各种模式,在对各模式计算公式相似性进行分析的基础上,针除平面模式之外的其他5种预测模式提出了一种自适应的并行处理模块,可高速计算预测像素值,在各种模式下处理完整的8×8块最少一个需时钟周期,最多6个时钟...
关键词：AVS 帧内预测 并行处理 视频解码 
AVS解码器中码流分割模块的硬件实现被引量：3
《电视技术》2009年第11期35-37,73,共4页李德斌 易清明 石敏 
广州市科技计划攻关项目(2007Z3-D3101);珠海市产学研项目(PC20082002)
提出一种基于AVS标准码流分割模块的硬件设计方案。简要介绍了码流分割模块的功能,根据码流特点进行硬件结构划分并重点阐述具体的硬件实现过程。采用Verilog HDL语言进行设计和仿真,实现了码流的正确解析,并与解码器其他模块结合通过了...
关键词：码流分割 AVS 解码器 VERILOG HDL 
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