小数分频

作品数：215被引量：300H指数：7
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基于扰动Delta-sigma调制器的小数分频器
《微波学报》2024年第4期86-90,共5页廖一龙 张浩 
文中基于扰动Delta-sigma调制器分析并设计了一款动态分频比控制的宽带小数分频器链路。其中,整数分频器链路由高速2分频器和7级2/3分频器链路级联构成,小数控制部分由外加扰动的Delta-sigma调制器构成。通过理论分析和仿真表明,合理选...
关键词：宽带 2/3分频器 扰动 DELTA-SIGMA调制器 
基于55 nm CMOS工艺的小数分频电荷泵锁相环设计被引量：1
《电子设计工程》2024年第12期71-75,共5页李金凤 郭瑞华 凌辛旺 于德明 
为解决无线射频收发机中锁相环存在的功耗高、精度低、不能小数分频等问题,提出了一种基于55 nmCMOS工艺的小数分频电荷泵锁相环,降低噪声对电路性能的影响,为无线收发机提供稳定的震荡信号。采用三阶噪声整形结构的数字Σ-Δ调制器,设...
关键词：电荷泵 锁相环 小数分频 Σ-Δ调制器 
基于DDS+PLL的频率合成方法研究
《环境技术》2024年第4期155-159,共5页王锋 郭中会 庞洋 张一萌 陈鹏 
针对传统的PLL在小数分频时引起的边界杂散问题,采用DDS作为PLL的参考时钟,通过动态调整DDS的输出频率及PLL的整数分频比,使PLL在整数分频模式下仍具有小步进的合成频率精度。经过理论分析和实测实验验证了方案的可行性,实测实验表明,采...
关键词：小数分频 边界杂散 DDS激励PLL 小步进 频率精度 
一种抗噪声折叠宽范围低杂散小数分频锁相环
《合肥工业大学学报（自然科学版）》2023年第12期1666-1670,1693,共6页蔡剑茹 尹勇生 滕海林 杨文杰 孟煦 
国家自然科学基金资助项目(61704043)。
由于电荷泵的电流失配,小数分频锁相环反馈路径上经整形的量化噪声会被折叠回低频偏处,恶化带内相位噪声的性能。文章提出一种自适应的抗噪声折叠技术,根据工作频率产生合适脉宽的电流以线性化环路,在全频带内避免噪声折叠的同时不恶化...
关键词：小数分频锁相环 噪声折叠 带内相位噪声 参考杂散 低抖动 
Ka频段小型化低功耗超宽带低相位噪声频率合成器的设计与实现
《现代电子技术》2023年第22期23-27,共5页鲁纯 韩周安 王飞龙 
提出一种小型化低功耗超宽带低相位噪声频率合成器的设计方法。设计一个输出频率为50 MHz~20 GHz、跳频步进1 Hz、@20 GHz相位噪声为≤-100 dBc/Hz@1 kHz和≤-110 dBc/Hz@10 kHz的超宽带低相位噪声频率合成器。利用小数分频锁相环和直...
关键词：频率合成器 超宽带 相位噪声 低功耗 小数分频 锁相环 
一种应用于宽带锁相环的小数分频器
《固体电子学研究与进展》2023年第3期259-265,共7页范海宇 张国华 沈剑 杨俊浩 马瑞山 
国家自然科学基金资助项目(62174149);江苏省自然基金资助项目(BK20211042)。
基于0.13μm SiGe BiCMOS工艺,设计了一款高性能的可编程小数分频器。采用电流模逻辑(Current mode logic,CML)设计了4/5双模分频器和19 bit的可编程计数器,实现了低相噪、宽分频比范围的整数分频。采用多级噪声整形结构Σ-Δ调制器,阶...
关键词：CML Σ-Δ调制器 小数杂散 相位噪声 
应用于时钟发生器的小数分频电路设计
《中国集成电路》2023年第4期25-31,共7页张林寒 杨俊浩 李小明 秦战明 
随着集成电路技术的迅猛发展,小数分频频率综合器已经广泛应用于通信系统中;芯片内对于时钟信号的稳定性以及分辨率的要求也越来越高,提高时钟信号的稳定性和分辨率是目前时钟发生器研究的重点。本文提出了一种高分辨率,高稳定性的小数...
关键词：延迟锁相环 相位内插 小数分频 相位锁定 
皮秒级可调脉宽脉冲码型生成电路设计被引量：2
《电子测量技术》2022年第15期14-20,共7页郭杨盛 苏淑靖 吴梦香 余毅 邢震震 
国家自然科学基金(51875534);山西省“1331工程”重点学科建设项目资助。
针对雷达、通信、电子计量与测试领域对高精度、低噪声、高分辨率、可编程脉冲信号的需求,设计了一种皮秒级可调脉宽脉冲码型生成电路,用于产生脉宽精密可控的多模式多功能系列化脉冲码型信号。该脉冲码型生成电路基于小数分频原理,改...
关键词：低噪声 皮秒级 小数分频锁相环 脉冲码型生成电路 
宽带低相噪低杂散Σ-Δ小数分频频率综合器被引量：1
《微电子学》2022年第4期668-674,共7页姚俊杰 张长春 张宇 张瑛 袁丰 
国家自然科学基金资助项目(62174090);江苏省“六大人才高峰”高层次人才资助项目(XYDXX-080)。
采用65 nm CMOS工艺,设计了一种宽带低相噪低杂散的Σ-Δ小数分频频率综合器。该频率综合器采用3个压控振荡器以及可编程分频链路实现宽带输出,每个压控振荡器采用自适应衬底偏置技术以减小PVT变化的影响。可编程分频器采用重定时单元...
关键词：频率综合器 Σ-Δ调制器 自动频率校准 压控振荡器 
一种低杂散的小数分频锁相环被引量：4
《微电子学》2021年第6期838-841,共4页李向超 
基于0.18μm CMOS工艺,设计了一种锁定频率范围在1.8~2.4 GHz的电荷泵锁相环。采用高性能的鉴频鉴相器、电荷泵以及三阶Σ-Δ调制器,减小了输出时钟的参考杂散。在Σ-Δ调制器中引入线性反馈移位寄存器(LFSR),生成伪随机序列,进一步降...
关键词：小数分频 电荷泵 锁相环 
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