进位链

作品数：38被引量：71H指数：7
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相关作者：崔珂朱日宏李瞳任仲杰秦熙更多>>
相关机构：京微雅格(北京)科技有限公司南京理工大学中国科学院大学合肥工业大学更多>>
相关期刊：《机电产品开发与创新》《电子技术应用》《光电子技术》《北京大学学报（自然科学版）》更多>>
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基于FPGA的高精度时间数字转换器设计与实现
《电子与封装》2025年第1期35-41,共7页项圣文 包朝伟 蒋伟 唐万韬 
深圳市技术攻关重点项目:重2022D006国产化高性能工业机器人控制器研发及应用(JSGGZD20220822095000001)。
高精度时间间隔测量是激光测距、雷达、示波器等多种科学和工程领域中的关键技术。为了提高测量的精确度,使用FPGA器件抽头延迟链实现高精度时间数字转换器(TDC),通过脉冲计数法和抽头延迟线法实现完整时钟周期和非完整时钟周期的测量,...
关键词：时间数字转换器 高精度 FPGA 进位链 抽头延迟线 
基于低成本FPGA实现TDC的进位链内插方法的研究
《南开大学学报(自然科学版)》2024年第6期7-12,共6页孙鑫悦 李佳薇 时羽辰 焦宇涛 任艺晨 赵二刚 岳钊 
国家自然科学基金(61871240);中央高校基本科研业务费专项资金项目。
分析了精密时间内插的原理与影响因素,提出一种基于反馈原理的细测量模块与基于环形计数器的粗计数模块的进位链内插方法 .此方法在Altera CycloneⅣ系列的低成本FPGA EP4CE30F17C8N中得到验证,验证结果显示本进位链内插方法可在低成本F...
关键词：TDC FPGA 延时链 时间内插 
基于FPGA的TDC测量中占用资源的研究
《机电产品开发与创新》2022年第6期107-109,共3页张雄林 王文俊 柏森洋 
在对时间间隔进行高精度测量的方法中,设计基于现场变成逻辑门阵列(FPGA)的时间数字转换器是最常见的。本文讨论基于FPGA的TDC设计,设计方法采用将系统分为“粗”测量模块和“细”测量模块的方式。“粗”测量模块的原理是运用直接计数法...
关键词：时间数字转换器 现场可编程逻辑门阵列 进位链 
皮秒级多脉冲时间间隔大量程时间测量系统设计被引量：1
《电子技术应用》2022年第10期108-112,共5页刘琛昊 金革 
国家自然科学基金(11875249)。
时间测量技术在激光测距、粒子鉴别、放射性核医学工程等领域中都有重要应用。本设计采用基于Altera公司的FPGA EP3C55F484C6结合时间内插技术来实现较高精度的时间数字转换器(Time-to-Digital Converter,TDC)。通过结合上位机,实现单...
关键词：时间数字转换器 现场可编程门阵列 多脉冲测量 进位链 
一种进位链TDC的实现及其抽头方式研究被引量：2
《电子技术应用》2022年第4期53-56,61,共5页李海涛 李斌康 田耕 阮林波 吕宗璟 
采用Xilinx公司的Kintex-7内部的进位链,实现了时间数字转换器(Time to Digital Converter,TDC)。采用码密度校准方法 对TDC进行逐位校准,标定了TDC的码宽。码密度校准过程中发现,不同的进位链抽头位置会导致TDC的码宽不同、非线性不同...
关键词：进位链 时间数字转换器 码密度校准 抽头方式 温度计码 冒泡现象 非线性 
高精度多路脉冲延时技术被引量：7
《强激光与粒子束》2021年第10期120-125,共6页潘昭浩 张政权 刘庆想 王廷轩 
国防重点研发项目。
针对全固态直线变压器驱动源(LTD)中大规模开关同步触发的需求,设计了一款基于ZYNQ-7000So C平台的全数字多路脉冲延时系统。介绍了该系统各功能模块,并重点从时间数字转换器(TDC)、多路脉冲输出及ARM核控制三个模块进行分析设计。详细...
关键词：同步触发 多路脉冲延时系统 片上系统 进位链 时间数字转换器 
FPGA进位链64通道时间数字转换器设计被引量：3
《核电子学与探测技术》2020年第6期916-921,共6页马毅超 李煜 李贞杰 李秋菊 蒋俊国 
国家自然科学基金(129-11705227)资助。
使用Xilink XC7K325TFBG676设计一种用于高能辐射光源(HEPS)APD探测器的64通道TDC。采用“粗计数”+“细测量”相结合的方法;通过Carry4构造64条抽头延时链,完成64通道的时间内插;采用两级触发器锁存结构降低亚稳态发生的概率;千兆以太...
关键词：同步辐射时间分辨 探测器 64通道 Carry4 TDC FPGA 
具有高资源利用率特征的改进型查找表电路结构与优化方法被引量：2
《电子与信息学报》2019年第10期2382-2388,共7页高丽江 杨海钢 李威 郝亚男 刘长龙 石彩霞 
该文着重研究了FPGA芯片中核心模块基本可编程逻辑单元(BLE)的电路结构与优化设计方法,针对传统4输入查找表(LUT)进行逻辑操作和算术运算时资源利用率低的问题,提出一种融合多路选择器的改进型LUT结构,该结构具有更高面积利用率;同时提...
关键词：基本可编程逻辑单元 查找表 进位链 映射 装箱 
基于码密度法的FPGA进位链时延标定被引量：9
《时间频率学报》2019年第3期240-247,共8页蔡东东 何在民 刘正阳 樊战友 武文俊 
中国科学院“西部之光”人才培养计划西部青年学者A类资助项目(XAB2017A05);国家自然科学基金资助项目(11703030)
现场可编程门阵列(FPGA)内部专用进位链资源可应用于时间数字转换(TDC)的高精度测量。各级专用进位链的延迟时间很小,一般量级为数十皮秒至一百多皮秒。基于FPGA实现TDC精密测量要解决的一个核心问题是如何精确标定各级进位链的延迟时间...
关键词：现场可编程门阵列 时间数字转换 码密度法 时间间隔测量 专用进位链 
一种基于FPGA的时间标定方法
《中国科技期刊数据库 工业A》2019年第4期414-416,共3页富佳佳 宁鹏 
时间标定是核物理医学、测距等相关领域中必不可少的一个重要环节,其时间分辨能力以及线性度的好坏将直接影响实验结果。本文提出利用FPGA内部的锁相环以及最小逻辑单元中的进位链进行级联的方式实现时间标定,采用Altera Cyclone10系列...
关键词：FPGA 时间标定 进位链 
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