可变长解码

作品数：8被引量：14H指数：2
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AVS及H.264双模可变长解码器设计被引量：1
《计算机工程》2012年第12期222-224,共3页周小龙 王祖强 魏先政 
为使视频解码芯片能同时兼容AVS及H.264这2种视频编码标准,设计一种双模可变长解码器。该设计复用码流缓冲移位和指数哥伦布解码模块,采用组合逻辑电路查找码表,对AVS和H.264码表进行优化与重组。在ModelSim环境下完成仿真测试,并通过F...
关键词：AVS标准 H.264标准 可变长解码 现场可编程门阵列芯片 指数哥伦布码 VERILOG硬件描述语言 
基于PowerPC的嵌入式MPEG4视频解码器的设计与实现被引量：5
《计算机工程与设计》2008年第6期1384-1386,1390,共4页刘振彪 肖国强 武兵 
阐述了XILINX公司Virtex II Pro系列FPGA的硬件结构,介绍了MPEG4SP及其解码过程。以ML310开发板为平台,利用Virtex II Pro系列的XC2VP30芯片实现了基于PowerPC405的嵌入式MPEG4 SP视频解码器。通过对硬件的配置和软件的优化,使系统能够...
关键词：嵌入式系统 视频解码器 纹理解码 可变长解码 运动补偿 
AVS中可变长解码器的硬件设计被引量：3
《现代电子技术》2007年第23期185-187,194,共4页刘群鑫 
AVS是我国自主制定的音视频编码技术标准。简要介绍AVS标准视频压缩部分的特点,重点研究AVS可变长熵解码的原理和技术方法并进行优化,主要采用并行解码结构以达到实时解码。在此基础上提出了一种针对AVS视频编码标准的变长码——指数哥...
关键词：AVS 解码器 可变长码 指数哥伦布码 
H.264片上高速可变长解码器设计被引量：2
《电子测量技术》2007年第10期7-10,32,共5页张楚 张盛兵 黄晁 赵彧 
宁波市高新技术研发与产业化计划项目资助
可变字长编解码是H.264标准中的一项重要技术,本文设计了一种基于H.264标准的高速可变字长解码器。设计上采用自顶向下的设计方法,首先进行系统结构设计,根据码流特点进行硬件结构划分,尽可能多地进行并行解码,采用桶形移位器。并用C语...
关键词：可变长解码 专用集成电路设计 H.264/A 亿 CAVLC 视频解码 
用于AVS和H.264可变长解码器的设计与实现被引量：1
《集成电路应用》2006年第1期44-47,共4页屠颖尊 解光军 黄晁 
可变长解码广泛用于各种视频压缩标准中。本文提出了一种适用于 AVS 和 H.264两种标准的可变长解码器。由于支持两个标准并且为了节省硬件,该结构采用模块的复用。采用桶型移位器,实现并行解码,提高解码速度。对解析 AVS 和 CAVLC 的码...
关键词：可变长解码 AVS解析 桶型移位器 H.264 
基于FPGA的并行可变长解码器的实现被引量：2
《电子技术应用》2005年第9期63-65,共3页蒋勇 罗玉平 
介绍了一种采用并行方式构建的多符号可变长码解码器。该解码器通过增加结构的复杂性和对硬件资源的占用,换取可变长码解码的高吞吐量。这种结构突破了可变长码码字之间的前向依赖性,可并行侦测出Buffer中的所有可能的码字。采用FPGA实...
关键词：可变长解码 现场可编程逻辑门阵列 硬件描述语言 FPGA实现 并行方式 解码器 可变 BUFFER 变长码 硬件资源 
基于FPGA的MPEG-4可变长解码器设计
《集成电路应用》2005年第8期51-54,共4页蒋勇 罗玉平 
本文讨论了一种高吞吐量流水方式构建的MPEG-4可变长解码器的设计与仿真结果。在这种解码器中,我们采用了基于PLA的并行解码算法,这种算法能够实现每个时钟解码一个码字。同时,为了提高解码的效率,降低操作的延迟,我们在设计中还引入了...
关键词：MPEG-4 可变长解码器 设计 FPGA 
在 TMS320C80 上实现的一种可变长解码算法
《上海交通大学学报》1998年第9期1-5,共5页谭径微 周璇 方勤 余松煜 
为提高在ＴＭＳ３２０Ｃ８０上开发Ｈ．２６３全软件解码系统的解码速度，减少片内ＲＡＭ与片外数据交换，提出了一种可变长解码（ＶＬＤ）算法．该算法根据Ｃ８０的高速并行处理能力和只有很小片内存储空间等特点，对ＶＬＤ码表进行设...
关键词：图象处理 可变长解码 视频解码 TMS320C80 
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