核设计

作品数：377被引量：608H指数：9
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相关作者：黄世恩娄磊王连杰魏彦琴于颖锐更多>>
相关机构：西安电子科技大学电子科技大学中国核动力研究设计院西北工业大学更多>>
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基于多核环境的嵌入式操作系统内核设计与实现
《时代汽车》2025年第3期144-146,共3页尤庆伸 
新能源汽车智能动力域控制器关键技术研究及应用(2023yf010)。
随着科技的快速发展,多核嵌入式系统日益成为现代计算领域的焦点。多核架构不仅提供了更高的计算性能,也带来了新的挑战和机遇。在这个背景下,多核嵌入式操作系统成为研究的热点。多核嵌入式操作系统不仅需要适应日益复杂的硬件架构,还...
关键词：多核环境 嵌入式操作系统 内核设计 实现 
基于FPGA的PMLSM三矢量模型预测电流控制IP核设计及硬件在环验证被引量：1
《半导体技术》2024年第11期988-997,共10页谭会生 卿翔 肖鑫凯 
湖南省教育厅科学研究重点项目(20A163);湖南省学位与研究生教学改革研究项目(2022JGYB183)。
为了提升永磁直线同步电机(PMLSM)电流控制的稳态性能和执行速度,同时降低资源消耗,基于现场可编程门阵列(FPGA)设计了一个三矢量模型预测电流控制(TV-MPCC)知识产权(IP)核,并利用FPGA在环可视化验证方法,建立了一个PMLSM的TV-MPCC IP...
关键词：永磁直线同步电机(PMLSM) 三矢量模型预测电流控制(TV-MPCC) 现场可编程门阵列(FPGA) 电流跟踪误差 电流脉动 
PCM核设计软件包全堆芯计算模块的验证
《核动力工程》2024年第4期17-23,共7页陆高奇 丁铭 兰兵 潘昕怿 李春 王超 马云帆 
国家自然科学基金项目(11405036)。
PCM软件包是中广核研究院有限公司自主研发的核设计软件包,包含组件截面计算软件PINE和三维堆芯核设计软件COCO。为了验证PCM软件包的全堆芯计算能力及其准确性,本文基于自制全堆芯例题以及国际通用的BIBLIS、IAEA、LRA等全堆芯基准题对...
关键词：堆芯核设计 堆芯基准题 PCM软件包 
面向高性能网络安全芯片的DDoS攻击识别IP核设计与实现被引量：1
《网络安全和信息化》2024年第5期137-139,共3页胡秀娟 
针对高性能网络安全芯片中的DDoS攻击识别问题,提出一种新的IP核设计与实现方案,能够有效防御DDoS攻击。
关键词：高性能网络 DDOS攻击 安全芯片 IP核设计 有效防御 识别问题 
用于LLC谐振拓扑的PFM发生器IP核设计
《集成电路应用》2024年第4期10-12,共3页芮天喆 曾庆立 
阐述LLC谐振拓扑的结构和频率特性,针对LLC谐振变换器对占空比固定为50%、频率可调节的需求,基于国产Seal 5000系列SA5Z-30-D1平台,提出一种带死区和互补输出的PFM发生器IP核。提出的IP核内部具有上下计数模式计数器和死区与互补生成模...
关键词：集成电路 PFM FPGA IP核 
自主化核设计软件瞬态分析模型的安全评价问题探讨
《核科学与工程》2024年第2期448-452,共5页戴阿灿 田欣鹭 王昆鹏 攸国顺 韩向臻 黄旭阳 靖剑平 
国家自然科学基金(11705066)项目资助。
受制于缺乏足够的瞬态数据,核设计软件瞬态分析模型的确认普遍存在不充分的问题,也给核设计软件的安全评价工作带来了较大的困难。本文介绍了在国内现有的数据基础上,针对核设计软件瞬态分析模型,所采用合理的安全评价的方法。本文的研...
关键词：核设计 瞬态 安全评价 
基于Veloce仿真器的DDR3 SDRAM故障模拟IP核设计
《电子器件》2024年第2期338-343,共6页田毅 刘畅 谢莉 马世耀 
中央高校基本科研业务费项目-自然科学类一般项目(3122019165)。
DDR3 SDRAM在高安全领域仍有广泛应用,为了在系统设计早期评估存储器故障对系统的影响,基于Veloce硬件仿真器设计了故障模拟IP核。该IP核基于Tcl脚本和BackDoor技术开发故障生成模块,能够模拟存储器器件软错误和硬错误故障;利用Tk工具...
关键词：硬件仿真 故障模拟 DDR3 SDRAM IP核 
一种基于HLS的目标跟踪IP核设计方法
《信息技术与信息化》2024年第3期87-90,共4页冯庭燕 齐宇心 
视频目标跟踪一直是计算机视觉领域非常重要的一个研究分支,多种目标跟踪算法都有着非常亮眼的跟踪效果。但为了适应更多应用场景,目标跟踪算法的结构不断复杂化,计算量的增加使跟踪精度高的算法难以保证实时性的要求。针对这一问题,提...
关键词：视频目标跟踪 核相关滤波 HLS 并行优化 IP核设计 
基于FPGA的8B/10B编解码IP核设计
《仪表技术与传感器》2023年第12期25-28,36,共5页周爽 周莉 
中国科学院国家重大科技专项(E16505B31S)。
8B/10B编码技术将数据和时钟合并传输,有效减少电缆数量,广泛应用于质量体积受限的航天器上。针对FPGA自带的8B/10B IP核受版权限制、代码不透明的问题,设计了一个自主可控、移植性好、运行速率高、可靠性强的8B/10B编解码的IP核,除时...
关键词：8B/10B编解码 时钟与数据恢复 同频多相采样 FPGA 
基于FPGA的UART自适应接收IP核设计被引量：1
《单片机与嵌入式系统应用》2023年第11期14-16,20,共4页徐胜 文丰 
为解决串行传输时发送方波特率多变情况下接收方每次都需要与发送方进行波特率约定的问题,设计了UART自适应接收IP核,在FPGA内部设置波特率库,利用0校验位和空闲位持续时间准确识别波特率,实现了UART的自适应接收,同时基于VHDL将整个模...
关键词：FPGA 波特率库 自适应接收 串行通信 IP核 
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