张承义

作品数：10被引量：12H指数：2
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供职机构：国防科学技术大学更多>>
发文主题：微处理器漏流功耗寄存器文件CACHE体系结构更多>>
发文领域：自动化与计算机技术电子电信建筑科学更多>>
发文期刊：《电子科技大学学报》《电子学报》《小型微型计算机系统》《计算机研究与发展》更多>>
所获基金：国家自然科学基金国家高技术研究发展计划国家科技重大专项教育部跨世纪优秀人才培养计划更多>>
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微体系结构软错误易感性阶段特性研究被引量：1
《电子科技大学学报》2012年第2期274-279,共6页成玉 马安国 张承义 张民选 
国家自然科学基金(60970036);国家863计划(2009AA01Z124;2009AA01Z102)
软错误易感性的阶段特性对微处理器进行动态容错管理是当前软错误研究领域的热点。针对体系结构弱点因子AVF是最常用的软错误易感性评估指标之一,提出了一种快速有效的AVF评估框架,对微处理器关键部件的AVF值进行评估。基于基本块和性...
关键词：阶段行为 阶段识别技术 可靠性评估 软错误 
Cache漏流功耗的自适应优化:动态容量调整
《国防科技大学学报》2011年第6期17-23,共7页张承义 郭维 周宏伟 
国家自然科学基金资助项目(60970036);国家863高技术资助项目(2009AA01Z124);国家"核高基"重大专项"超高性能CPU新型架构研究"资助项目(2011ZX01028-001-001)
当集成电路制造工艺水平发展到超深亚微米阶段,漏流功耗所占的比例越来越大,成为微处理器功耗的重要来源。漏流功耗同电压、漏电流和晶体管数量等因素密切相关。Cache是微处理器中面积较大的部件,对其漏流功耗进行优化是微处理器低功耗...
关键词：微处理器 高速缓冲存储器 漏流功耗 容量调整 
基于统计信息的Cache漏流功耗估算方法被引量：1
《计算机研究与发展》2008年第2期367-374,共8页周宏伟 张承义 张民选 
国家"八六三"高技术研究发展计划基金项目(2005AA110020)
随着工艺尺寸的缩小,漏流功耗逐渐成为制约微处理器设计的主要因素之一.Sleep Cache与Drowsy Cache是两种降低Cache漏流功耗的重要技术.基于统计信息的Cache漏流功耗估算方法(SB-CLPE)用于对Sleep Cache或Drowsy Cache进行Cache漏流功...
关键词：统计信息 漏流功耗 估算 SLEEP CACHE Drowsy CACHE 
一种基于统计信息的Cache漏流功耗估算模型
《计算机工程与科学》2007年第6期81-83,127,共4页周宏伟 张承义 张民选 
国家863计划资助项目(2005AA110020)
本文提出了一种基于统计信息的Cache漏流功耗估算模型。该模型通过对Cache访问间隔时间的统计,估算出不同衰退间隔条件下Cache的漏流功耗。根据该模型所设计的Cache漏流功耗模拟器与Hotleakage漏流功耗模拟器相比,对于Cache漏流功耗估...
关键词：统计 CACHE 漏流功耗 估算模型 
片内二级Cache的静态功耗优化技术研究被引量：2
《计算机工程与科学》2007年第3期77-79,90,共4页张承义 张民选 
国家自然科学基金资助项目(60376018;60273069;90207011)
随着集成电路制造工艺进入超深亚微米阶段,静态功耗在微处理器总功耗中所占的比例越来越大,尤其是片上二级Cache。在开发新的低漏流工艺和电路技术之外,如何在体系结构级控制和优化静态功耗成为业界研究的热点。本文提出了一种ADSR算法...
关键词：微处理器 二级CACHE 静态功耗 ADSR 
组相联Cache中漏流功耗优化技术研究被引量：3
《小型微型计算机系统》2007年第2期372-375,共4页张承义 张民选 邢座程 
国家自然科学基金项目(60376018;60273069;90207011)资助.
随着集成电路制造工艺进入超深亚微米阶段,漏电流功耗在微处理器总功耗中所占的比例越来越大,在开发新的低漏流工艺和电路技术之外,如何在体系结构级控制和优化漏流功耗成为业界研究的热点.Cache在微处理器中面积最大,是进行漏流控制和...
关键词：微处理器 组相联cache 漏电流功耗 LRu—assist 
LRU-Assist:一种高效的Cache漏流功耗控制算法被引量：6
《电子学报》2006年第9期1626-1630,共5页张承义 张民选 邢座程 王永文 
国家自然科学基金(No.60376018;60273069;90207011)
随着集成电路制造工艺进入超深亚微米阶段,漏电流功耗在微处理器总功耗中所占的比例越来越大,在开发新的低漏流工艺和电路技术之外,如何在体系结构级控制和优化漏流功耗成为业界研究的热点.Cache在微处理器中面积最大,是进行漏流控制的...
关键词：微处理器 cache功耗 漏电流 LRU-assist 
高性能通用微处理器体系结构关键技术研究被引量：1
《计算机研究与发展》2006年第6期987-992,共6页张民选 王永文 邢座程 邓让钰 蒋江 张承义 
国家自然科学基金项目(60273069);国家"八六三"高技术研究发展计划基金项目(2002AA110020)~~
X处理器是我国自主设计的基于EPIC思想的高性能通用微处理器·介绍了8级流水线和OLSM执行模型,以很少的硬件代价克服了基本EPIC模型的局限性·设计了一种多分支预测结构,支持多条分支指令的并行执行,并通过判定执行减少分支指令的数目;...
关键词：微处理器 体系结构 并行 分支 存储器 
一种消除无效操作降低ASIC功耗的设计技术
《计算机工程与科学》2002年第6期84-87,共4页张民选 王永文 张承义 高军 
国家自然科学基金重点资助项目 (6993 3 0 3 0 ) ;国家"863"计划基金资助项目 (863 3 0 6 ZD11 0 1 1) ;教育部跨世纪优秀人才培养计划基金资助项目 (教技函 [2 0 0 0 ] 1号文件 )
低功耗设计是当前ASIC研究的热点。本文提出了一种简单的功耗估算模型 ,针对流水线结构设计了一种工作标志控制单相和双相时钟的机制 ,消除无效操作以降低ASIC的功耗 。
关键词：ASIC 时钟 异步电路 专用集成电路 功耗估算模型 设计 
针对ASIC中记忆部件的易测试性设计技术被引量：1
《计算机工程与科学》2002年第4期68-70,共3页张民选 张承义 王永文 高军 
国家自然科学基金重点项目资助 (6993 3 0 3 0 );国家"八六三"高技术研究发展计划基金 (863 3 0 6 ZD11 0 1 1);教育部"跨世纪优秀人才培养计划基金"资助项目 (教技函 [2 0 0 0 ] 1号文件 )
本文提出了一种简洁有效的、针对ASIC中记忆部件的易测试性设计技术 ,可消除部分不可测故障 ,提高故障覆盖率。
关键词：ASIC 记忆部件 易测试性设计 专用大规模集成电路 故障覆盖率 
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