SYSTEMVERILOG

作品数：78被引量：128H指数：6
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基于UVM的片上网络路由器验证平台
《计算机测量与控制》2024年第10期201-207,共7页王鑫 翟周伟 
高等学校学科创新引智计划项目(B23008);未来网络科研基金项目(FNSRFP2021YB11)。
路由器是片上网络的关键组件,其性能对于整个网络的性能具有重要影响;针对片上网络路由器进行功能验证,采用SystemVerilog和自动化脚本搭建了基于通用验证方法学(UVM)的验证平台,简化了验证流程;在验证平台中,通过划分多个agent向路由...
关键词：片上网络路由器 验证平台 覆盖率 SYSTEMVERILOG 人工智能芯片 
基于VIP与SystemVerilog的硬件加速器仿真模型设计
《计算机与网络》2024年第4期307-313,共7页杜越 吴益然 郑杰良 
河北省创新能力提升计划项目(225A0201D)。
随着片上系统(System on Chip,SoC)芯片规模与功能复杂度的膨胀,硬件加速器已成为大规模SoC的重要组成部分。为了缩短产品交付时间,有必要开发硬件加速器仿真模型,以在SoC设计初期支撑架构的探索与评估。在对硬件加速器的特点与建模需...
关键词：硬件加速器 仿真模型 片上系统 信箱 旗语 SYSTEMVERILOG 验证IP 
基于SystemVerilog的验证架构
《电子元器件与信息技术》2024年第4期44-47,共4页毛茏玮 李勇 曾鹏 
可编程逻辑器件软件测试中通常采用工程原生平台注入Verilog激励的验证架构,而如今绝大多数现场可编程逻辑门阵列(FPGA)软件均采用分层设计,基于Verilog的验证架构复杂度高、验证容错低等缺陷逐渐暴露。针对大规模数据处理类FPGA程序验...
关键词：验证架构 FPGA软件 System Verilog 
基于SystemVerilog的SoC系统控制单元的验证
《电子设计工程》2023年第23期100-103,共4页戴兆麟 赵启林 李超 刘璐 
随着片上系统(System-on-Chip,SoC)成为芯片的主流形式,为协调与控制片上各个IP模块,通常在总线端设有控制单元使系统达到硬件资源配置、面积、功耗的统一,控制单元功能的正确性、完备性变得越来越重要。通过以覆盖率驱动的随机化验证...
关键词：SOC 系统控制单元 数字验证 SYSTEMVERILOG 覆盖率 
Python SystemVerilog (Python SV)
《World Journal of Engineering and Technology》2023年第3期409-416,共8页Santhosh Nagaraj Nag 
This paper discusses Python SystemVerilog (Python SV), a simulation-based verification approach leveraging the power of Python and SystemVerilog. The use of Python-implemented UVM classes in SystemVerilog enables user...
关键词：Python-SystemVerilog (Python-SV) Design Framework Simulation 
基于SystemVerilog的浮点数约束生成器的研究与实现
《现代雷达》2023年第7期75-82,共8页吴沁文 王珊珊 
SystemVerilog是专用于FPGA验证的语言,它的约束随机机制是支持FPGA随机测试的关键。然而,SystemVerilog语言仅提供了对整数类型的约束随机机制,这大大限制了需要使用浮点数随机激励的验证。文中设计了一种基于SystemVerilog的浮点数约...
关键词：SystemVerilog语言 FPGA验证 约束随机 浮点数 
一种高效率可重构的CPU验证平台被引量：4
《电子与封装》2021年第11期25-30,共6页刘春锐 张宏奎 黄旭东 陈振娇 
现有的CPU验证平台大多基于指令码匹配技术搭建,这种方式开发周期长、调试难度高。在CPU芯片的设计中,高效和完备的功能验证已成为CPU可靠性的重要依据。针对某32位CPU芯片的验证需求,提出了一种高效率可重构的CPU验证平台,并完成了该...
关键词：CPU 验证平台 功能验证 SYSTEMVERILOG 
基于SystemVerilog的图像采集压缩卡芯片验证平台设计被引量：2
《电子测量技术》2021年第20期29-36,共8页王凯 王骞 符云越 李拓 刘凯 
山东省重大科技创新工程项目(2019JZZY010103)资助。
验证平台对视频采集压缩卡芯片的开发设计有重要作用。针对传统的验证平台在代码覆盖率以及测试效率方面存在的不足,设计了一款基于SystemVerilog搭建的验证平台,该验证平台采用面向对象程序语言设计,其中,PCIe host(RP)端采用Xilinx I...
关键词：SYSTEMVERILOG 功能验证 自动化验证 覆盖率收敛 
基于SystemVerilog的超高频RFID标签数字基带设计与研究被引量：6
《电子技术应用》2021年第1期36-40,共5页汪永峰 卜刚 
江苏省自然科学基金(BK2012792)。
在ISO/IEC 18000-6C标准协议的基础上,对超高频射频识别(UHF RFID)标签数字基带的设计与实现展开研究。根据协议规定的标签数字基带的设计要求和指标,采用SystemVerilog分别对标签发送和接收基带进行建模,并给出基带中关键模块的理论推...
关键词：ISO/IEC 18000-6C SYSTEMVERILOG 通信链路 RFID 仿真验证 
基于SystemVerilog的数字基带通信芯片的验证被引量：7
《南开大学学报（自然科学版）》2020年第6期1-4,共4页乔鹏丽 吕英杰 
随着集成电路设计复杂度的提高,验证的难度也随之提高,传统的基于Verilog搭建的验证平台已经不能满足要求.以数字基带通信芯片为验证对象,基于SystemVerilog语言建立一种双向通信的验证平台.该验证平台采用类的思想进行设计,使其更易于...
关键词：验证平台 双向通信 SYSTEMVERILOG 分层次 
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