SOC芯片

作品数：461被引量：423H指数：9
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基于高速安全存储SoC芯片的PCIe集成验证
《微电子学与计算机》2025年第1期84-91,共8页商建东 闫法瑞 于哲 郭恒亮 
河南省重大科技专项(221100210600)。
高速串行总线(Peripheral Component Interconnect express,PCIe)是一种计算机高速串行扩展总线协议,能够提供点对点高带宽传输。自研高速安全存储系统级芯片(System on Chip,SoC)在高速传输的需求之上提出了对PCIe接口需求。为验证自...
关键词：集成验证 系统级芯片 高速串行总线 通用验证方法学 验证知识产权 
基于无线自供能的植入式微纳集成芯片与集成系统
《微电子学与计算机》2023年第11期80-87,共8页叶乐 高猛 张雅聪 高成臣 刘昱 刘欣 赵博 孟凡瑞 桂林 林俊淑 苏彬 马盛林 马伯志 祝斌 梁辰 黄如 
国家重点研发计划项目(2019YFB2204900)。
我国是慢性病大国,癌症、糖尿病、心脏病、癫痫、高血压等疾病已成为首要致死原因,医疗负担占比70%,形势严峻.相比口服,注射等传统给药方式,植入式精准靶向治疗按时按需、精准适量,见效迅速,几乎无副作用,被证实是慢性病的有效治疗方式...
关键词：SOC芯片 微纳集成 靶向给药系统 迷走神经刺激器 
一种高可靠SoC芯片的系统级设计方法被引量：4
《微电子学与计算机》2018年第7期54-57,共4页柳泽辰 蒋剑飞 王琴 关宁 
上海航天科技创新基金(SAST201355)
为了实现SoC在系统级的高可靠设计,文本搭建了一个包括PowerPC、DRAM、DMA、SRAM模块的SoC系统级设计平台,并采用VCI总线协议实现互连.针对高可靠性问题,本文提出并实现了三模冗余与ECC纠错编码相结合的存储加固方法,通过一个图像数据...
关键词：系统级芯片 三模冗余 错误检测和纠正 电子系统级设计 高可靠 
一种可重构的数字视频处理SoC芯片验证平台被引量：5
《微电子学与计算机》2009年第2期62-65,共4页葛晨阳 王东 孙宏滨 张超 张斌 
国家"八六三"计划项目(2006AA01Z192)
为降低平板电视数字视频处理芯片开发的成本和周期、适应平板显示器件技术的快速更新,提出了一种基于FPGA的可重构的数字视频处理SoC芯片验证平台,并详细介绍了该验证平台主子板分离设计的思想和结构组成.基于该平台的数字视频处理芯片D...
关键词：数字视频 验证平台 SOC 可编程逻辑门阵列 可重构 
一款雷达信号处理SOC芯片的存储器内建自测试设计被引量：5
《微电子学与计算机》2008年第7期95-99,共5页饶全林 何春 饶青 刘辉华 
内建自测试(BIST)为嵌入式存储器提供了一种有效的测试方法.详细介绍了存储器故障类型及内建自测试常用的March算法和ROM算法.在一款雷达信号处理SOC芯片中BIST被采用作为芯片内嵌RAM和ROM的可测试性设计的解决方案.利用BIST原理成功地...
关键词：存储器内建自测试 故障模型 MARCH算法 ROM算法 可测试性设计 
基于3G SIM卡SoC芯片设计的AMBA总线的精简策略
《微电子学与计算机》2008年第3期104-106,110,共4页封君 蒲智星 王新安 
AMBA总线是SoC设计中普遍采用的总线架构,它对许多具体的设计项目往往显得过于庞大,结合3G SIM卡SoC芯片的设计,研究了AMBA总线架构的若干精简策略,提出了一些对总线进行裁剪的参考方法,经过AHB VIP验证环境表明结果可行.该方法对基于A...
关键词：AMBA总线 SIM卡 AHB VIP 验证 
SoC芯片中关键路径的优化方法研究被引量：1
《微电子学与计算机》2006年第4期141-145,共5页李黎 付宇卓 汪宁 
文章对SoC系统综合时关键路径的处理方法进行了研究,从多路器电路、状态机电路以及算术单元电路三个角度,分析各种实现方式的利弊,提出了在满足系统性能的要求下进行代码设计优化的指导原则和方法,并且用DesignCompiler进行综合并分析...
关键词：SOC 综合 RTL优化 关键路径 
WLAN SOC芯片BX501的FPGA验证平台设计与实现被引量：2
《微电子学与计算机》2006年第1期97-98,102,共3页张开明 王新安 张国新 苟卫忠 
国家"863"课题多模无线广域网和无线局域网系统芯片开发(2003AA1Z1210)
系统芯片(SOC)设计是以模块复用和软硬件协同设计为基础,基于FPGA的验证平台是一种有效的验证途径。文章讨论了WLANSOC芯片BX501的验证平台的两种实现方案,介绍了采用XILINXVIRTEX-II系列FPGA的设计实现;同时对SOC设计的FPGA验证问题进...
关键词：无线局域网 现场可编程逻辑门阵列 系统芯片 验证平台 
深亚微米SOC芯片物理设计中基于串扰的时序收敛方法被引量：2
《微电子学与计算机》2006年第1期85-88,共4页王丽英 杨军 罗岚 
当芯片设计进入深亚微米,串扰效应引起大量的设计违规,尤其是对时序收敛产生很大的影响。实际上串扰对电路时序性能的影响非常难估计,它不仅取决于电路互联拓扑,而且还取决于连线上信号的动态特征。文章从串扰延时的产生原因开始分析,...
关键词：深亚微米 串扰 时序收敛 
一款低功耗SoC芯片的时钟管理策略被引量：6
《微电子学与计算机》2005年第3期32-35,共4页戴红卫 郭炜 韩泽耀 王琴 
文章提出一种系统级和RTL级协同设计的时钟管理策略,显著地降低了时钟网络的动态功耗,弥补了现有工具只能在设计后期才能发挥作用的不足,达到降低整个SoC芯片功耗的目的;同时,分析该方案实现中可能存在的问题,并给出解决方案。
关键词：协同设计 时钟网络 功耗 
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